[發明專利]錯誤檢測在審
| 申請號： | 202010916167.8 | 申請日： | 2020-09-03 |
| 公開（公告）號： | CN112445639A | 公開（公告）日： | 2021-03-05 |
| 發明（設計）人： | F·羅曼;M·利薩特;P·阿努爾 | 申請（專利權）人： | 意法半導體(魯塞)公司;意法半導體(ALPS)有限公司 |
| 主分類號： | G06F11/07 | 分類號： | G06F11/07;G06F11/10 |
| 代理公司： | 北京市金杜律師事務所 11256 | 代理人： | 董莘 |
| 地址： | 法國*** | 國省代碼： | 暫無信息 |
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| 摘要： | |||
| 搜索關鍵詞： | 錯誤 檢測 | ||
1.一種方法，包括通過以下步驟將數據寫入存儲器中：
將表示所述數據和糾錯碼或檢錯碼的二進制字至少劃分成第一部分和第二部分；以及
將所述第一部分寫入在第一存儲器電路中的邏輯地址處；以及
將所述第二部分寫入在第二存儲器電路中的所述邏輯地址處，其中所述第二存儲器電路不同于所述第一存儲器電路，并且所述第二存儲器電路被配置為存儲與所述第一存儲器電路一樣多的二進制字；
其中，所述糾錯碼或檢錯碼取決于所述數據和所述邏輯地址兩者。
2.根據權利要求1所述的方法，其中所述第一部分和所述第二部分各自具有相同的尺寸。
3.根據權利要求1所述的方法，其中所述二進制字是所述數據和所述糾錯碼或檢錯碼的級聯。
4.根據權利要求1所述的方法，其中所述數據和所述邏輯地址由單個第一處理器提供。
5.根據權利要求1所述的方法，其中所述數據和所述邏輯地址由至少一個第二處理器和第三處理器提供。
6.根據權利要求5所述的方法，其中將由所述第二處理器提供的所述數據與由所述第三處理器提供的所述數據進行比較，并且將由所述第二處理器提供的所述邏輯地址與由所述第三處理器提供的所述邏輯地址進行比較。
7.根據權利要求5所述的方法，其中所述第二處理器將所述邏輯地址提供給至少兩個所述存儲器電路中的一個存儲器電路，并且所述第三處理器將所述邏輯地址提供給至少兩個所述存儲器電路中的另一個存儲器電路。
8.根據權利要求5所述的方法，其中所述第二處理器將所述邏輯地址提供給至少兩個所述存儲器電路。
9.根據權利要求1所述的方法，其中所述第一存儲器電路和所述第二存儲器電路均具有相同的尺寸。
10.根據權利要求1所述的方法，其中至少兩個所述存儲器電路的內部控制信號被比較。
11.根據權利要求1所述的方法，還包括通過以下步驟從所述存儲器讀取所述數據：
從所述第一存儲器電路讀取在所述邏輯地址處的所述第一部分；并且
從所述第二存儲器電路讀取在所述邏輯地址處的所述第二部分。
12.根據權利要求11所述的方法，其中讀取還包括：將分別從所述第一存儲器電路和所述第二存儲器電路讀取的所述第一部分和所述第二部分進行級聯，以形成讀取的二進制字。
13.根據權利要求12所述的方法，通過從所述讀取的二進制字去除所述糾錯碼或檢錯碼來獲得所述數據。
14.根據權利要求13所述的方法，還包括：通過基于自所述存儲器讀取的所述數據再次計算所述糾錯碼或檢錯碼，來檢測在所述數據中的錯誤。
15.根據權利要求14所述的方法，還包括：驗證所述糾錯碼或檢錯碼。
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