[發明專利]區塊鏈數字簽名方法與系統在審
| 申請號： | 201910575768.4 | 申請日： | 2019-06-28 |
| 公開（公告）號： | CN110400141A | 公開（公告）日： | 2019-11-01 |
| 發明（設計）人： | 李雪雷;趙雅倩;李仁剛 | 申請（專利權）人： | 蘇州浪潮智能科技有限公司 |
| 主分類號： | G06Q20/38 | 分類號： | G06Q20/38;G06Q40/04 |
| 代理公司： | 北京集佳知識產權代理有限公司 11227 | 代理人： | 林哲生 |
| 地址： | 215100 江蘇省蘇州市吳*** | 國省代碼： | 江蘇;32 |
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| 摘要： | |||
| 搜索關鍵詞： | 區塊 簽名類型 應用主程序 目標數字 簽名處理 協處理器 主處理器 數字簽名系統 硬件加速 流水化 處理器 調用 并行 | ||
1.一種區塊鏈數字簽名方法，其特征在于，基于區塊鏈數字簽名系統，所述區塊鏈數字簽名系統包括主處理器和協處理器；所述主處理器至少用于運行區塊鏈應用主程序；所述協處理器作為硬件加速單元，用于運行多個數字簽名子程序；所述多個數字簽名子程序對應不同的數字簽名類型；
所述方法包括：
所述主處理器運行所述區塊鏈應用主程序；
在需要進行數字簽名處理時，所述區塊鏈應用主程序確定所需執行的數字簽名處理所屬的數字簽名類型；確定出的數字簽名類型為目標數字簽名類型；所述目標數字簽名類型對應的數字簽名子程序為數字簽名子程序；
所述區塊鏈應用主程序調用所述協處理器運行所述目標數字簽名子程序，以進行并行和流水化的數字簽名處理。
2.如權利要求1所述的方法，其特征在于，所述主處理器為通用CPU；所述協處理器為現場可編程門陣列FPGA。
3.如權利要求2所述的方法，其特征在于，在所述調用協處理器運行所述目標數字簽名子程序之前，所述區塊鏈應用主程序還用于執行如下操作：
準備待處理數據集；
創建主機端與FPGA端進行數據通信的緩存；
將輔助數據集傳輸到所述緩存；
將準備好的待處理數據集傳輸到所述緩存；
設置FPGA端運行所需的參數信息；
在所述調用協處理器運行所述目標數字簽名子程序之后，所述區塊鏈應用主程序還用于執行如下操作：
在所述FPGA端返回完成信號之后，讀取FPGA端的執行結果。
4.如權利要求3所述的方法，其特征在于，所述協處理器運行所述目標數字簽名子程序，以進行并行和流水化的數字簽名處理包括：
從所述緩存處讀取所述輔助數據集和所述待處理數據集；
依據所述輔助數據集，對所述待處理數據集中的數據進行并行和流水化的計算操作；
將計算操作所得數據寫入所述緩存；
在對所述待處理數據集中的數據的計算結束后，向主機端返回完成信號。
5.如權利要求3所述的方法，其特征在于，所述參數信息包括：
緩存大小、數據的寫入和讀出配置信息、所述目標數字簽名子程序的執行配置信息以及FPGA平臺信息。
6.如權利要求2-5任一項所述的方法，其特征在于，
在所述主處理器運行所述區塊鏈應用主程序之前，所述方法還包括：
采用高級語言完成多種類型的數字簽名算法的描述，得到所述多個數字簽名子程序；
通過映射工具完成所述多種類型的數字簽名算法的描述到FPGA所執行比特流的自動化映射，生成相應的AOCX文件；
對所述主程序進行編譯，生成可在所述通用CPU上執行的可執行程序文件。
7.如權利要求6所述的方法，其特征在于，
所述主處理器運行所述區塊鏈應用主程序包括：所述通用CPU運行所述可執行程序文件；
所述協處理器運行所述目標數字簽名子程序包括：所述FPGA運行所述目標數字簽名子程序對應的AOCX文件。
8.一種區塊鏈數字簽名系統，其特征在于，包括主處理器和作為硬件加速單元的協處理器；其中，所述協處理器用于運行多個數字簽名子程序；所述多個數字簽名子程序對應不同的數字簽名類型；
所述主處理器用于：
運行區塊鏈應用主程序；
在需要進行數字簽名處理時，確定所需執行的數字簽名處理所屬的數字簽名類型；確定出的數字簽名類型為目標數字簽名類型；所述目標數字簽名類型對應的數字簽名子程序為數字簽名子程序；
調用所述協處理器運行所述目標數字簽名子程序，以進行并行和流水化的數字簽名處理。
9.如權利要求8所述的系統，其特征在于，所述主處理器為CPU；所述協處理器為現場可編程門陣列FPGA。
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