[發(fā)明專利]一種基于時(shí)鐘周期的脈寬調(diào)制信號(hào)占空比倍增電路有效
| 申請(qǐng)?zhí)枺?/td> | 201811352796.1 | 申請(qǐng)日： | 2018-11-14 |
| 公開（公告）號(hào)： | CN109525224B | 公開（公告）日： | 2020-08-04 |
| 發(fā)明（設(shè)計(jì)）人： | 朱金橋 | 申請(qǐng)（專利權(quán)）人： | 上?？鸵骐娮佑邢薰?/a> |
| 主分類號(hào)： | H03K3/017 | 分類號(hào)： | H03K3/017;H03K5/05;H03K7/08 |
| 代理公司： | 上海信好專利代理事務(wù)所(普通合伙) 31249 | 代理人： | 潘朱慧;朱成之 |
| 地址： | 201210 上海市浦東新區(qū)*** | 國(guó)省代碼： | 上海;31 |
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| 摘要： | |||
| 搜索關(guān)鍵詞： | 一種 基于 時(shí)鐘 周期 脈寬調(diào)制 信號(hào) 倍增 電路 | ||
1.一種基于時(shí)鐘周期的脈寬調(diào)制信號(hào)占空比倍增電路，其特征在于，
其輸入端輸入時(shí)鐘信號(hào)CLK和原始脈寬調(diào)制信號(hào)PWM1；所述原始脈寬調(diào)制信號(hào)PWM1的高電平的持續(xù)時(shí)間是N個(gè)時(shí)鐘信號(hào)CLK的時(shí)鐘周期之和，所述原始脈寬調(diào)制信號(hào)PWM1的低電平的持續(xù)時(shí)間是M個(gè)時(shí)鐘信號(hào)CLK的時(shí)鐘周期之和；
其輸出端輸出占空比倍增后的脈寬調(diào)制信號(hào)PWM2，所述占空比倍增后的脈寬調(diào)制信號(hào)PWM2的高電平和低電平持續(xù)時(shí)間都是所述時(shí)鐘信號(hào)CLK的整數(shù)個(gè)時(shí)鐘周期之和，所述占空比倍增后的脈寬調(diào)制信號(hào)PWM2的周期與所述原始脈寬調(diào)制信號(hào)PWM1的周期相等；所述占空比倍增后的脈寬調(diào)制信號(hào)PWM2的高電平持續(xù)時(shí)間是K*N個(gè)時(shí)鐘信號(hào)CLK的時(shí)鐘周期之和，或者所述占空比倍增后的脈寬調(diào)制信號(hào)PWM2的低電平持續(xù)時(shí)間是K*M個(gè)時(shí)鐘信號(hào)CLK的時(shí)鐘周期之和；
其中，參數(shù)N、M均為大于0的整數(shù)，參數(shù)K為大于1的整數(shù)；
所述脈寬調(diào)制信號(hào)占空比倍增電路包含：
占空比倍增使能脈沖產(chǎn)生電路(101)，其輸入端輸入時(shí)鐘信號(hào)CLK和原始脈寬調(diào)制信號(hào)PWM1，所述原始脈寬調(diào)制信號(hào)PWM1的高電平和低電平的持續(xù)時(shí)間都是時(shí)鐘信號(hào)CLK的整數(shù)個(gè)時(shí)鐘周期之和，其輸出端輸出PWM倍增起始使能脈沖信號(hào)Pulse1和PWM倍增結(jié)束使能脈沖信號(hào)Pulse2；
占空比倍增電路(102)，其輸入端輸入所述PWM倍增起始使能脈沖信號(hào)Pulse1和所述PWM倍增結(jié)束使能脈沖信號(hào)Pulse2，其輸出端輸出占空比倍增后的脈寬調(diào)制信號(hào)PWM2；所述占空比倍增后的脈寬調(diào)制信號(hào)PWM2的脈沖寬度與所述PWM倍增起始使能脈沖信號(hào)Pulse1和PWM倍增結(jié)束使能脈沖信號(hào)Pulse2相適配，且所述占空比倍增后的脈寬調(diào)制信號(hào)PWM2通過所述時(shí)鐘信號(hào)CLK進(jìn)行信號(hào)同步，保證占空比倍增后的脈寬調(diào)制信號(hào)PWM2的高電平和低電平持續(xù)時(shí)間都是所述時(shí)鐘信號(hào)CLK的整數(shù)個(gè)時(shí)鐘周期之和；
所述占空比倍增使能脈沖產(chǎn)生電路(101)包含：占空比倍增起始使能脈沖產(chǎn)生電路(201)，其輸入端輸入所述時(shí)鐘信號(hào)CLK和所述原始脈寬調(diào)制信號(hào)PWM1，其輸出端輸出所述PWM倍增起始使能脈沖信號(hào)Pulse1；占空比倍增結(jié)束使能脈沖產(chǎn)生電路(202)，其輸入端輸入所述時(shí)鐘信號(hào)CLK和所述原始脈寬調(diào)制信號(hào)PWM1，其輸出端輸出PWM倍增結(jié)束使能脈沖信號(hào)Pulse2；
所述占空比倍增結(jié)束使能脈沖產(chǎn)生電路(202)進(jìn)一步包含：
第一計(jì)數(shù)器(203)，其輸入端輸入所述時(shí)鐘信號(hào)CLK和所述原始脈寬調(diào)制信號(hào)PWM1，用于統(tǒng)計(jì)原始脈寬調(diào)制信號(hào)PWM1的脈沖持續(xù)時(shí)間所對(duì)應(yīng)的時(shí)鐘信號(hào)CLK的周期數(shù)；所述第一計(jì)數(shù)器(203)在原始脈寬調(diào)制信號(hào)PWM1脈沖開始后開始計(jì)數(shù)，并且在原始脈寬調(diào)制信號(hào)PWM1脈沖結(jié)束后保持并輸出第一計(jì)數(shù)值；
第二計(jì)數(shù)器(204)，其輸入端輸入所述時(shí)鐘信號(hào)CLK和所述原始脈寬調(diào)制信號(hào)PWM1，用于統(tǒng)計(jì)原始脈寬調(diào)制信號(hào)PWM1脈沖任意一次結(jié)束直至下一次結(jié)束的期間內(nèi)所對(duì)應(yīng)的時(shí)鐘信號(hào)CLK的周期數(shù)；所述第二計(jì)數(shù)器(204)在原始脈寬調(diào)制信號(hào)PWM1脈沖結(jié)束后開始計(jì)數(shù)，并連續(xù)進(jìn)行計(jì)數(shù)，輸出第二計(jì)數(shù)值；
計(jì)數(shù)值比較電路(205)，其輸入端輸入所述第一計(jì)數(shù)值和所述第二計(jì)數(shù)值，當(dāng)所述第一計(jì)數(shù)值和所述第二計(jì)數(shù)值的數(shù)值不相等時(shí)，輸出保持為低電平，當(dāng)所述第一計(jì)數(shù)值和所述第二計(jì)數(shù)的數(shù)值相等時(shí)，輸出所述PWM倍增結(jié)束使能脈沖信號(hào) Pulse2。
2.如權(quán)利要求1所述的基于時(shí)鐘周期的脈寬調(diào)制信號(hào)占空比倍增電路，其特征在于，
所述參數(shù)K等于2。
3.如權(quán)利要求1所述的基于時(shí)鐘周期的脈寬調(diào)制信號(hào)占空比倍增電路，其特征在于，
所述PWM倍增起始使能脈沖信號(hào)Pulse1可為高電平或者低電平，所述PWM倍增結(jié)束使能脈沖信號(hào)Pulse2可為高電平或者低電平。
4.如權(quán)利要求1所述的基于時(shí)鐘周期的脈寬調(diào)制信號(hào)占空比倍增電路，其特征在于，
所述原始脈寬調(diào)制信號(hào)PWM1的上升沿和下降沿與所述時(shí)鐘信號(hào)CLK的上升沿同步，或者，所述原始脈寬調(diào)制信號(hào)PWM1的上升沿和下降沿與所述時(shí)鐘信號(hào)CLK的下降沿同步。
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