[發明專利]數據編碼方法、存儲器控制電路單元與存儲器存儲裝置有效
| 申請號: | 201710830622.0 | 申請日: | 2017-09-15 |
| 公開(公告)號: | CN109508252B | 公開(公告)日: | 2022-03-01 |
| 發明(設計)人: | 許祐誠;林緯;楊宇翔 | 申請(專利權)人: | 群聯電子股份有限公司 |
| 主分類號: | G06F11/10 | 分類號: | G06F11/10;G11C8/14 |
| 代理公司: | 北京同立鈞成知識產權代理有限公司 11205 | 代理人: | 馬雯雯;臧建明 |
| 地址: | 中國臺灣*** | 國省代碼: | 臺灣;71 |
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| 摘要: | |||
| 搜索關鍵詞: | 數據 編碼 方法 存儲器 控制電路 單元 存儲 裝置 | ||
1.一種數據編碼方法,用于可復寫式非易失性存儲器模塊,所述可復寫式非易失性存儲器模塊具有多個存儲單元以及多個字元線,所述多個存儲單元中的每一個存儲單元具有第一有效比特以及第二有效比特,所述多個存儲單元形成多個實體程序化單元組,所述多個實體程序化單元組之中的每一個實體程序化單元組具有多個實體程序化單元,所述多個存儲單元被配置于所述多個字元線與多個比特線的交錯處,所述多個存儲單元中的多個第一存儲單元位于所述多個字元線中的第一字元線上,所述多個存儲單元中的多個第二存儲單元位于所述多個字元線中的第二字元線上,其中所述多個第一存儲單元位于所述第一字元線與所述多個比特線中的第一比特線組的交錯處,所述多個第二存儲單元位于所述第二字元線與所述多個比特線中的第二比特線組的交錯處,所述第一比特線組以及所述第二比特線組互不相同,所述數據編碼方法包括:
將第一數據寫入至所述多個實體程序化單元組中的第一實體程序化單元組的第一實體程序化單元,其中所述多個第一存儲單元形成所述第一實體程序化單元組,所述多個第一存儲單元中的所述第一有效比特形成所述第一實體程序化單元并用以存儲所述第一數據;
將第二數據寫入至所述多個實體程序化單元組中的第二實體程序化單元組的第二實體程序化單元,其中所述多個第二存儲單元形成所述第二實體程序化單元組,所述多個第二存儲單元中的所述第二有效比特形成所述第二實體程序化單元并用以存儲所述第二數據;以及
編碼所述第一數據以及所述第二數據產生編碼數據。
2.根據權利要求1所述的數據編碼方法,還包括:
將所述編碼數據寫入至所述多個實體程序化單元組中的第三實體程序化單元組中。
3.根據權利要求1所述的數據編碼方法,所述多個存儲單元中的每一個存儲單元還具有第三有效比特,所述方法還包括:
將第三數據寫入至所述多個實體程序化單元組中的第四實體程序化單元組的第三實體程序化單元,其中所述多個存儲單元中的多個第三存儲單元形成所述第四實體程序化單元組,所述多個第三存儲單元中的所述第三有效比特形成所述第三實體程序化單元并用以存儲所述第三數據;
其中編碼所述第一數據以及所述第二數據產生所述編碼數據的步驟包括:
編碼所述第一數據、所述第二數據以及所述第三數據產生所述編碼數據。
4.根據權利要求3所述的數據編碼方法,其中
所述多個第三存儲單元位于所述多個字元線中的第三字元線上。
5.根據權利要求4所述的數據編碼方法,所述多個第三存儲單元位于所述第三字元線與所述多個比特線中的第三比特線組的交錯處,所述第一比特線組、所述第二比特線組以及所述第三比特線組互不相同。
6.根據權利要求3所述的數據編碼方法,其中所述編碼數據用以更正在寫入所述第一數據、所述第二數據以及所述第三數據時分別在所述第一實體程序化單元、所述第二實體程序化單元以及所述第三實體程序化單元所引起的錯誤。
7.根據權利要求3所述的數據編碼方法,其中所述第一實體程序化單元為上實體程序化單元,所述第二實體程序化單元為下實體程序化單元,所述第三實體程序化單元為中實體程序化單元。
8.根據權利要求1所述的數據編碼方法,其中編碼所述第一數據以及所述第二數據產生所述編碼數據的步驟包括:
使用里德-所羅門碼(Reed-solomon codes,RS codes)算法或互斥或(XOR)算法來編碼所述第一數據以及所述第二數據以產生所述編碼數據。
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