[發明專利]用于選擇包括指令序列的指令的系統和方法有效
| 申請號： | 201580052960.5 | 申請日： | 2015-07-24 |
| 公開（公告）號： | CN106796528B | 公開（公告）日： | 2021-08-24 |
| 發明（設計）人： | M·阿布達拉 | 申請（專利權）人： | 英特爾公司 |
| 主分類號： | G06F9/455 | 分類號： | G06F9/455 |
| 代理公司： | 上海專利商標事務所有限公司 31100 | 代理人： | 何焜 |
| 地址： | 美國加利*** | 國省代碼： | 暫無信息 |
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| 摘要： | |||
| 搜索關鍵詞： | 用于 選擇 包括 指令 序列 系統 方法 | ||
1.一種用于不可知的運行時架構的系統，包括：
處理器；
系統仿真/虛擬化轉換器；
應用代碼轉換器，其中所述系統仿真/虛擬化轉換器和所述應用代碼轉換器實現系統仿真過程；以及
系統轉換器，其中所述系統轉換器實現用于執行來自訪客鏡像的代碼的系統和應用轉換過程，并且其中所述系統仿真過程或者所述系統和應用轉換過程能操作以實現：
運行提前運行時訪客指令轉換/解碼過程；以及
預取過程，其中從指令序列中的訪客分支的對應目標預取訪客代碼，所述訪客代碼被轉換為本機轉換塊，
其中，所述訪客代碼與所述本機轉換塊之間的地址映射被高速緩存在轉換后備緩沖器CLB中，并且其中，CLB計數器在轉換時刻被設定并且每當指令序列被執行時被遞減；并且
其中，如果所述CLB計數器達到閾值，則所述指令序列通過硬件展開優化而被優化，在所述硬件展開優化中，硬件用于保持對分支偏移決定是真還是假的跟蹤，并且用于在分支被誤預測的情況下跳轉到存儲器中的原始代碼以執行正確的指令序列同時轉儲清除被誤預測的指令序列。
2.如權利要求1所述的系統，其特征在于，最頻繁遇到的訪客指令和它們的映射被存儲在低級高速緩存結構。
3.如權利要求1所述的系統，其特征在于，映射表用于為查找到的訪客指令格式提供等效的指令格式。
4.如權利要求1所述的系統，其特征在于，所述訪客代碼包括訪客鏡像，所述訪客鏡像包括應用代碼和操作系統/系統特定代碼以供執行。
5.如權利要求1所述的系統，進一步包括多個轉換表，所述多個轉換表包括耦合到所述訪客取出緩沖器的第一級轉換表和第二級轉換表，用于將所述訪客代碼變換為對應的本機代碼。
6.一種微處理器，包括：
系統仿真/虛擬化轉換器；
應用代碼轉換器，其中所述系統仿真/虛擬化轉換器和所述應用代碼轉換器實現系統仿真過程；以及
系統轉換器，其中所述系統轉換器實現用于執行來自訪客鏡像的代碼的系統和應用轉換過程，并且其中所述系統仿真過程或者所述系統和應用轉換過程能操作以實現：
運行提前運行時訪客指令轉換/解碼過程；以及
預取過程，其中從指令序列中的訪客分支的對應目標預取訪客代碼，所述訪客代碼被轉換為本機轉換塊，
其中，所述訪客代碼與所述本機轉換塊之間的地址映射被高速緩存在轉換后備緩沖器CLB中，并且其中，CLB計數器在轉換時刻被設定并且每當指令序列被執行時被遞減；并且
其中，如果所述CLB計數器達到閾值，則所述指令序列通過硬件展開優化而被優化，在所述硬件展開優化中，硬件用于保持對分支偏移決定是真還是假的跟蹤，并且用于在分支被誤預測的情況下跳轉到存儲器中的原始代碼以執行正確的指令序列同時轉儲清除被誤預測的指令序列。
7.如權利要求6所述的微處理器，其特征在于，最頻繁遇到的訪客指令和它們的映射被存儲在低級高速緩存結構。
8.如權利要求6所述的微處理器，其特征在于，映射表用于為查找到的訪客指令格式提供等效的指令格式。
9.如權利要求6所述的微處理器，其特征在于，所述訪客代碼包括訪客鏡像，所述訪客鏡像包括應用代碼和操作系統/系統特定代碼以供執行。
10.如權利要求6所述的微處理器，進一步包括多個轉換表，所述多個轉換表包括耦合到所述訪客取出緩沖器的第一級轉換表和第二級轉換表，用于將所述訪客代碼變換為對應的本機代碼。
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