[發明專利]糾正軟錯誤的固件機制無效
| 申請號: | 200910132513.7 | 申請日: | 2000-10-04 |
| 公開(公告)號: | CN101539875A | 公開(公告)日: | 2009-09-23 |
| 發明(設計)人: | N·T·夸克 | 申請(專利權)人: | 英特爾公司 |
| 主分類號: | G06F11/16 | 分類號: | G06F11/16 |
| 代理公司: | 中國專利代理(香港)有限公司 | 代理人: | 張雪梅;劉春元 |
| 地址: | 美國加利*** | 國省代碼: | 美國;US |
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| 摘要: | |||
| 搜索關鍵詞: | 糾正 錯誤 機制 | ||
1.一種處理器,包括:
第一執行核心,可在分離模式或冗余模式中操作,所述第一執行核 心包括第一指令高速緩存;以及第二執行核心,第二執行核心在分離 模式中獨立于第一執行核心來處理指令,而在冗余模式中與第一執行 核心以鎖定步驟處理指令,第二執行核心包括第二指令高速緩存和選 擇器,所述選擇器在冗余模式中從第一指令高速緩存中選擇指令而在 分離模式中從第二指令高速緩存中選擇指令。
2.權利要求1的處理器,還包括:校驗單元,用于在第一和第二 執行核心處于冗余模式時比較來自第一和第二執行核心的結果以便檢 測錯誤。
3.權利要求2的處理器,還包括:與第一執行核心相關聯的第一 組一個或多個存儲結構,用于存儲第一執行核心的處理器狀態數據; 以及與第二執行核心相關聯的第二組一個或多個存儲結構,用于存儲 第二執行核心的處理器狀態數據。
4.權利要求3的處理器,其中,第一和第二組一個或多個存儲結 構是受奇偶保護的。
5.權利要求2的處理器,其中,當所述校驗單元檢測到錯誤時, 第一和第二執行核心切換到分離模式并將未被破壞的處理器狀態數據 保存到第一和第二組一個或多個存儲結構的每一個的不可高速緩存的 部分。
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